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河南理工大学-数字电子技术
下列描述正确的是() A.时序逻辑电路某一时刻的电路状态取决于电路进入该时刻前所处的状态 B.寄存器只能存储小量数据,存储器可存储大量数据 C.主从JK触发器主触发器具有一次翻转性 D.上面描述至少有一个不正确
下列描述正确的是() A.EEPROM具有数据长期保存的功能且比EPROM使用方便 B.集成二—十进制计数器和集成二进制计数器均可方便扩展 C.将移位寄存器首尾相连可构成环形计数器 D.上面描述至少有一个不正确
下列说法正确的是() A.逻辑代数有与、或、非三种基本运算 B.任何一个复合逻辑都可以用与、或、非三种基本运算构成 C.异或和同或与与、或、非运算无关 D.同或和异或互为反运算
时序电路的异步复位信号作用于复位端时,不可使时序电路()复位 A.在CLK上升沿 B.在CLK下降沿 C.在CLK为高电平期间 D.立即
下列说法不正确的是() A.卡诺图中的每一个小方块都代表着一个最小项 B.卡诺图中最小项的排列方式是按最小项从小到大数字编号顺序排列 C.卡诺图中最小项的排列方式是按最小项从大到小数字编号顺序排列 D.卡诺图中最小项的排列方式是随机排列
下列等式正确的是() A.A+AB+B=A+B B.AB+AB′=A+B C.A(AB)′=A+B′ D.A(A+B+C)′=B′C′
VIL表示什么含义() A.输出低电平 B.输入高电平 C.输出高电平 D.输入低电平
触发器异步输入端为低电平有效时,如果异步输入端RD’=1,SD’=0,则触发器直接置成()状态 A.0 B.1 C.0,1 D.不确定
下列说法正确的是() A.加法器不可以设计成减法器 B.用加法器可以设计任何组合逻辑电路 C.用加法器不可以设计组合逻辑电路 D.用加法器可以设计组合逻辑电路,但逻辑函数必须能化成两个数相加的形式
下列说法正确的是() A.卡诺图中的每一个小方块都代表着一个最小项 B.卡诺图中最小项的排列方式是按最小项从小到大数字编号顺序排列 C.卡诺图中最小项的排列方式是按最小项从大到小数字编号顺序排列 D.卡诺图中最小项的排列方式是随机排列
下列说法正确的是() A.同步时序电路中,所有触发器状态的变化都是同时发生的 B.异步时序电路的响应速度与同步时序电路的响应速度完全相同 C.异步时序电路的响应速度比同步时序电路的响应速度慢 D.异步时序电路中,触发器状态的变化不是同时发生的
不常用的BCD码有() A.奇偶校验码 B.格雷码 C.8421码 D.ASCII码
在下列逻辑电路中,是组合逻辑电路的有( ) A.译码器 B.编码器 C.全加器 D.寄存器
下列说法正确的是() A.时序电路与组合电路具有不同的特点,因此其分析方法和设计方法也不同 B.时序电路任意时刻的状态和输出均可表示为输入变量和电路原来状态的逻辑函数 C.用包含输出与输入逻辑关系的函数式不可以完整地描述时序电路的逻辑功能 D.用包含输出与输入逻辑关系的函数式可以完整地描述时序电路的逻辑功能
逻辑函数Y(A,B,C,D)=∑m(1,2,4,9,10,11,12)的最简与或式为() A.BC’D’+B’D+AB’C B.BC’D’+AB’D+B’CD’ C.B’+C’D’ D.BC’D’+AB’D+B’C’D+B’CD’